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GE PCIE-5565-PIORC反射內(nèi)存卡 高

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光纖反射內(nèi)存網(wǎng)絡(luò)硬件延時測試報告結(jié)論摘要

1)數(shù)據(jù)包在整個環(huán)網(wǎng)上的延時

網(wǎng)絡(luò)數(shù)據(jù)從開始發(fā)送到在環(huán)網(wǎng)流轉(zhuǎn)一周的總延時為:總延時≈600*(節(jié)點數(shù)-1)+3*光纖線長,單位:ns。

2)通過PCI總線進行板卡反射內(nèi)存讀寫的延時

PCI總線在寫時,需要準(zhǔn)備時間為5CLK約0.125us,之后每讀取4Bytes個數(shù)據(jù)需要3個CLK約0.075us。因此,PCI寫入N個數(shù)據(jù)的延時可表示為:0.125us+ (N%4 + 1) *0.075us

六、應(yīng)用舉例:基于光纖反射內(nèi)存網(wǎng)實現(xiàn)遠(yuǎn)程多試驗室協(xié)同試驗

隨著戰(zhàn)場環(huán)境復(fù)雜度的提高,半實物仿真實驗面臨更嚴(yán)峻的挑戰(zhàn)。由于試驗場地面積有限,各大型仿真非標(biāo)設(shè)備常分布于不同樓宇的試驗室內(nèi),完成仿真試驗需要多樓宇、多試驗室跨域聯(lián)合進行。同時,面臨試驗資源緊的問題,需要多項試驗并行進行。這對多試驗室遠(yuǎn)程互連及并行試驗提出了迫切的需求,而遠(yuǎn)程協(xié)同仿真技術(shù)中的數(shù)據(jù)實時交互技術(shù)是解決上述問題的關(guān)鍵。本文采用基于光纖HUB的實時光纖反射內(nèi)存網(wǎng)絡(luò)搭建系統(tǒng)硬件平臺,實現(xiàn)多試驗室協(xié)同試驗仿真。

在多試驗任務(wù)并舉的情況下,綜合考慮不同試驗室聯(lián)合仿真的需要,兼顧數(shù)據(jù)通訊的安全性和線纜連接的方便性,本節(jié)以三個實驗室協(xié)同仿真為例,采用實時光纖反射內(nèi)存、HY-FHX8型光纖HUB搭建網(wǎng)絡(luò),通過試驗綜合控制系統(tǒng)實現(xiàn)光纖網(wǎng)絡(luò)的集中管理

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